verilog로 구현된 클럭 곱셈회로
verilog로 클럭 곱셈회로를 만들고 싶읍니다.
verilog로 클럭 분주회로는 많이들 나와 있습니다.
저는 입력 클럭 주파수에 대해서 클럭 주파수 곱셈회로를 만들고 싶은데
어떻게 만들어야 할까요
가령 입력 클럭이 1KHz이면 출력 클럭은 2KHz의 클럭을 생성하는 논리 입니다.
만들려고 하니깐 아이디어가 안떠오르네요
고수님들 도와 주세요
익명 작성일 - 안녕하세요...
베릴로그는 아니지만, vhdl을 공부하고 있는 사람입니다.
일전에 저도 그런 시도를 하려고 했었습니다.
여러 방법을 모색한결과 클럭의 라이징 일때와 폴링일때 플립플롭의 상태변화를 주는 방법을 찾았으나,
컴파일러에 따라 컴파일이 되는것도 있고 안되는것도 있었습니다.
그래서 마지막 솔루션으로 자일링스의 ip를 사용했습니다. ㅡㅡ
베릴로그도 아마 vhdl과 비슷하리라는 생각이 듭니다만은,
방법을 찾지 못하신다면 자일링스의 DCM을 이용해 보세요..
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